TMS320C6418ZTSA500 - TI

Изображения приведены только для примера, точные характеристики можно узнать из паспорта изделия.

Часть №

TMS320C6418ZTSA500
Производитель

TI
Чип воркер Часть №

CW20692850
Категория

Цифровой сигнальный процессор DSP
Упаковка

FCBGA-288
Описание

DSP Fixed-Point 32Bit 500MHz 4000MIPS 288Pin FCBGA
даташит

Datasheet

Способ оплаты и доставка

TMS320C6418ZTSA500 Глобальный поставщик

{{ supplierTable.supplier }}	{{ supplierTable.part }}	{{ supplierTable.availability }}	MOQ	{{ supplierTable.delivery_date }}

{{viewMore}}
{{viewMore}}
DigiKey	{{noList.partNo}} {{noList.mfr}}	0 {{ search_item }}	-	{{outStock}}
Arrow	{{noList.partNo}} {{noList.mfr}}	0 {{ search_item }}	-	{{outStock}}
Mouser	{{noList.partNo}} {{noList.mfr}}	0 {{ search_item }}	-	{{outStock}}
					{{submitRFQ}}

TMS320C6418ZTSA500 Цифровой сигнальный процессор DSP характеристики

Атрибут	Значение атрибута

Часть №	TMS320C6418ZTSA500
Производитель	TI
Чип воркер Часть №	CW20692850
Категория	Цифровой сигнальный процессор DSP
даташит	Datasheet
Стиль Монтажа	Surface Mount
Количество Выводов	288 Pin
Корпус/Пакет	FCBGA-288
Частота	500 MHz
Напряжение Питания (DC)	1.14V (min)
Тактовая Частота	500 MHz
Рабочая температура (Макс)	105 ℃
Рабочая температура (мин)	-40 ℃
	Развернуть все
Длина	23 mm
Ширина	23 mm
Высота	1.9 mm
Рабочая Температура	-40℃ ~ 105℃
Жизненный Цикл Продукта	Active
Упаковка	Tray
RoHS Комплаенс	Non-Compliant
Бессвинцовая Статус	Contains Lead
ECCN кодекс	3A991.a.2

TMS320C6418ZTSA500 Описание продукта

The TMS320C64x DSPs (including the TMS320C6418 device) are the highest-performance fixed-point DSP generation in the TMS320C6000 DSP platform. The TMS320C6418 (C6418) device is based on the second-generation high-performance, advanced VelociTI very-long-instruction-word (VLIW) architecture (VelociTI.2) developed by Texas Instruments (TI). The high-performance, lower-cost C6418 DSP enables customers to reduce system costs for telecom, software radio, Digital Terrestrial Television Broadcasting (DTTB), and digital Broadcast Satellite/Communication Satellite (BS/CS) applications. The C64x is a code-compatible member of the C6000 DSP platform.
With performance of up to 4800 million instructions per second (MIPS) at a clock rate of 600 MHz, the C6418 device offers cost-effective solutions to high-performance DSP programming challenges. The C6418 DSP possesses the operational flexibility of high-speed controllers and the numerical capability of array processors. The C64x. DSP core processor has 64 general-purpose registers of 32-bit word length and eight highly independent functional unitstwo multipliers for a 32-bit result and six arithmetic logic units (ALUs)with VelociTI.2 extensions. The VelociTI.2 extensions in the eight functional units include new instructions to accelerate the performance in video and imaging applications and extend the parallelism of the VelociTI architecture. The C6418 can produce four 16-bit multiply-accumulates (MACs) per cycle for a total of 2400 million MACs per second (MMACS), or eight 8-bit MACs per cycle for a total of 4800 MMACS. The C6418 DSP also has application-specific hardware logic, on-chip memory, and additional on-chip peripherals similar to the other C6000 DSP platform devices.
The C6418 device has a high-performance embedded coprocessor [Viterbi Decoder Coprocessor (VCP)] that significantly speed up channel-decoding operations on-chip. The VCP operating at CPU clock divided-by-4 can decode over 500 7.95-Kbps adaptive multi-rate (AMR) [K = 9, R = 1/3] voice channels. The VCP supports constraint lengths K = 5, 6, 7, 8, and 9, rates R = 1/2, 1/3, and 1/4, and flexible polynomials, while generating hard decisions or soft decisions. Communications between the VCP and the CPU are carried out through the EDMA controller.
The C6418 uses a two-level cache-based architecture and has a powerful and diverse set of peripherals. The Level 1 program cache (L1P) is a 128-Kbit direct mapped cache and the Level 1 data cache (L1D) is a 128-Kbit 2-way set-associative cache. The Level 2 memory/cache (L2) consists of an 4-Mbit memory space that is shared between program and data space. L2 memory can be configured as mapped memory, cache (up to 256K bytes), or combinations of the two. The peripheral set includes: two multichannel buffered audio serial ports (McASPs); two inter-integrated circuit bus modules (I2Cs) ; two multichannel buffered serial ports (McBSPs); three 32-bit general-purpose timers; a user-configurable 16-bit or 32-bit host-port interface (HPI16/HPI32); a 16-pin general-purpose input/output port (GP0) with programmable interrupt/event generation modes; and a 32-bit glueless external memory interface (EMIFA), which is capable of interfacing to synchronous and asynchronous memories and peripherals.
Each McASP port supports one transmit and one receive clock zone, with six serial data pins which can be individually allocated to any of the two zones. The serial port supports time-division multiplexing on each pin from 2 to 32 time slots. The C6418 has sufficient bandwidth to support all six serial data pins transmitting a 192-kHz stereo signal. Serial data in each zone may be transmitted and received on multiple serial data pins simultaneously and formatted in a multitude of variations on the Philips Inter-IC Sound (I2S) format.
In addition, the McASP transmitter may be programmed to output multiple S/PDIF, IEC60958, AES-3, CP-430 encoded data channels simultaneously, with a single RAM containing the full implementation of user data and channel status fields.
McASP also provides extensive error-checking and recovery features, such as the bad clock detection circuit for each high-frequency master clock which verifies that the master clock is within a programmed frequency range.
The I2C ports on the TMS320C6418 allows the DSP to easily control peripheral devices and communicate with a host processor. In addition, the standard multichannel buffered serial port (McBSP) may be used to communicate with serial peripheral interface (SPI) mode peripheral devices.
The C6418 has a complete set of development tools which includes: a new C compiler, an assembly optimizer to simplify programming and scheduling, and a Windows debugger interface for visibility into source code execution.

Развернуть все

Доставка

CDEK

Itella

SHIPTOR

SPSR-EXPRESS

Чип воркер Квалификация

Информация для заказа

Заказ Оплата Доставка Пакет Обеспечение качества

Данные условия носят справочный характер, фактические условия зависят от предложения продавца.
- Пожалуйста, уточняйте технические характеристики продукции при заказе.
- MOQ - минимальное количество заказа, необходимое для приобретения каждой детали.
- Если у вас есть особые инструкции по заказу, пожалуйста, укажите их на странице заказа.
- При заказе будет использоваться предотгрузочная инспекция.
- Вы можете проверить статус заказа в разделе «Мои заказы» вашего личного кабинета.
- Заказы не могут быть отменены после того, как посылка была отправлена. Узнать больше >
- работает как с физическими так и с юридическими лицами. Узнать больше >
- Все цены на сайте указаны с НДС 20%.
- Счета выставляются в валюте, оплата производится в рублях по курсу на день оплаты.
- Если вам нужен подробный счет-фактура или налоговый идентификатор, пожалуйста, напишите нам.
- После отправки товара в Россию доставка займет от 1 до 2 недель.
- Обработка Вашего заказа осуществляется только после оплаты счета.
- Номер для отслеживания будет выслан после отправки заказа. (Для отображения информации перевозчиком может потребоваться до 24 часов). Узнать больше >
- Тщательно проверено и упаковано компанией Чип воркер
- Вакуумная упаковка
- Антистатическая упаковка
- Антивибрационный пенопласт
- Контроль качества доходов, 800+ квалифицированных дистибьюторов.
- Авторитеты проверяют микросхему, чтобы гарантировать качество, подлинность и безопасность вашего устройства.
- Контроль декапсуляции
- Рентгеновский контроль
- XRF-инспекция
- Электрические испытания
- Тестирование поверхности